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EDAJSYVHDL4PPT配套教學課件1第3章 VHDL數據類型與順序語句.ppt

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第3章 VHDL數據類型與順序語句 3.1 VHDL數據類型 3.1.1 BIT和BIT_VECTOR類型 3.1 VHDL數據類型 3.1.2 STD_LOGIC和STD_LOGIC_VECTOR類型 3.1 VHDL數據類型 3.1.3 整數類型INTEGER 3.1 VHDL數據類型 3.1.4 布爾數據類型BOOLEAN 3.1.5 SIGNED和UNSIGNED類型 3.1 VHDL數據類型 3.1 VHDL數據類型 3.1 VHDL數據類型 3.1.6 其他預定義類型 1. 字符類型 2. 實數類型 3. 字符串類型 3.1 VHDL數據類型 4. 時間類型 3.1 VHDL數據類型 5. 文件類型 3.1 VHDL數據類型 3.1.7 數據類型轉換函數 3.1 VHDL數據類型 3.1.7 數據類型轉換函數 3.1 VHDL數據類型 3.1.7 數據類型轉換函數 3.1 VHDL數據類型 3.2 VHDL最常用的順序語句 3.2.1 賦值語句 信號賦值語句變量賦值語句 賦值目標賦值符號賦值源 3.2 VHDL最常用的順序語句 3.2.2 CASE語句 3.2 VHDL最常用的順序語句 3.2.2 CASE語句 3.2 VHDL最常用的順序語句 3.2.3 PROCESS語句 3.2.4 并置操作符 ? 3.2 VHDL最常用的順序語句 3.2.5 IF語句 3.3 IF語句使用示例 3.3.1 D觸發器的VHDL描述 3.3 IF語句使用示例 1. 上升沿檢測表達式和信號屬性函數EVENT 2. 不完整條件語句與時序電路 3.3 IF語句使用示例 1. 上升沿檢測表達式和信號屬性函數EVENT 2. 不完整條件語句與時序電路 3.3 IF語句使用示例 3.3 IF語句使用示例 3.3.2 含異步復位和時鐘使能的D觸發器的VHDL描述 3.3 IF語句使用示例 3.3.2 含異步復位和時鐘使能的D觸發器的VHDL描述 3.3 IF語句使用示例 3.3.3 基本鎖存器的VHDL描述 3.3 IF語句使用示例 3.3.3 基本鎖存器的VHDL描述 3.3 IF語句使用示例 3.3.4 含清0控制的鎖存器的VHDL描述 3.3 IF語句使用示例 3.3.5 VHDL實現時序電路的不同表述方式 3.3 IF語句使用示例 3.3.5 VHDL實現時序電路的不同表述方式 3.3 IF語句使用示例 3.3.6 4位二進制加法計數器設計 3.3 IF語句使用示例 3.3.7 計數器更常用的VHDL表達方式 3.3 IF語句使用示例 3.3.7 計數器更常用的VHDL表達方式 3.3 IF語句使用示例 3.3.8 實用計數器的VHDL設計 3.3 IF語句使用示例 3.3.8 實用計數器的VHDL設計 3.3 IF語句使用示例 3.3.8 實用計數器的VHDL設計 3.3 IF語句使用示例 3.3.9 含同步并行預置功能的8位移位寄存器設計 3.3 IF語句使用示例 3.3.9 含同步并行預置功能的8位移位寄存器設計 3.3 IF語句使用示例 3.3.10 優先編碼器設計 3.3 IF語句使用示例 3.3.10 優先編碼器設計 3.4 VHDL其它順序語句 3.4.1 LOOP循環語句 (1)單個LOOP語句 3.4 VHDL其它順序語句 3.4.1 LOOP循環語句 (2)FOR_LOOP語句 3.4 VHDL其它順序語句 3.4.2 NEXT語句 3.4 VHDL其它順序語句 3.4.2 NEXT語句 3.4 VHDL其它順序語句 3.4.3 EXIT語句 3.4 VHDL其它順序語句 3.4.4 WAIT語句 3.4 VHDL其它順序語句 3.4.4 WAIT語句 3.4 VHDL其它順序語句 3.4.4 WAIT語句 3.4 VHDL其它順序語句 3.4.4 WAIT語句 3.4 VHDL其它順序語句 3.4.4 WAIT語句 3.4 VHDL其它順序語句 3.4.4 WAIT語句 3.4 VHDL其它順序語句 3.4.5 GENERIC參數定義語句 3.4 VHDL其它順序語句 3.4.6 REPORT語句 3.4 VHDL其它順序語句 3.4.7 斷言語句 3.4 VHDL其它順序語句 1. 順序斷言語句 3.4 VHDL其它順序語句 2. 并行斷言語句 3.4 VHDL其它順序語句 3.4.8 端口數據含1個數統計電路模塊設計 習 題3-2
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